使用分频器产生时钟约束FPGA

谁借莪1个温暖的怀抱¢ 2024-03-23 19:06 44阅读 0赞

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    之前遇到时钟需要分频的时候,直接用计数器和源时钟产生,然后把这个分频时钟的上升沿作为敏感事件去写了,今天看了特权同学的书,也自己在网上看了看,这样做是不好的,降低了系统的可靠性